数字信号处理VLSI实现的可测性设计研究

项目负责人谢永乐
依托单位电子科技大学
立项年份2004
学科分类集成电路设计
资助来源国家自然科学基金
项目状态已立项
资助金额¥25.0万
批准号90407007

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